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電子發燒友網>電子資料下載>可編程邏輯>FPGA/ASIC>使用FPGA實現數字鎖相環的設計資料說明

使用FPGA實現數字鎖相環的設計資料說明

2020-08-06 | rar | 1.98 MB | 次下載 | 免費

資料介紹

  許多電子設備要正常工作,通常需要外部的輸入信號與內部的振蕩信號同步,利用鎖相環路就可以實現這個目的。

  鎖相環路是一種反饋控制電路,簡稱鎖相環( PLL)。鎖相環的特點是:利用外部輸入的參考信號控制環路內部振蕩信號的頻率和相位。因鎖相環可以實現輸出信號頻率對輸入信號頻率的自動跟蹤, 所以鎖相環通常用于閉環跟蹤電路。鎖相環在工作的過程中, 當輸出信號的頻率與輸入信號的頻率相等時, 輸出電壓與輸入電壓保持固定的相位差值, 即輸出電壓與輸入電壓的相位被鎖住, 這就是鎖相環名稱的由來。

  鎖相環通常由鑒相器( PD)、環路濾波器( LF)和壓控振蕩器( VCO)三部分組成,原理框圖如圖3-1 所示。

  鎖相環的工作原理如下:

  1. 壓控振蕩器的輸出經過采集并分頻;

  2. 和輸入信號同時輸入鑒相器;

  3. 鑒相器通過比較上述兩個信號的頻率差,然后輸出一個直流脈沖電壓;

  4. 控制VCO,使它的頻率改變;

  5. 這樣經過一個很短的時間, VCO的輸出就會穩定于某一期望值。

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