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電子發燒友網>電子資料下載>電子論文>數字信號處理論文>基于跳躍式Wallace樹的低功耗32位乘法器

基于跳躍式Wallace樹的低功耗32位乘法器

2009-04-17 | rar | 130 | 次下載 | 免費

資料介紹

為了提高乘法器的綜合性能,從3個方面對乘法器進行了優化設計。采用改進的Booth算法生成各個部分積,利用跳躍式Wallace樹結構進行部分積壓縮,通過改進的LING加法器對壓縮結果進行求和。在FPGA上進行驗證與測試,并在0.18 μm SMIC工藝下進行邏輯綜合及布局布線。結果表明,與采用傳統Wallace樹結構的乘法器相比,該乘法器的延時減少了29%,面積減少了17%,功耗降低了38%,能夠滿足高性能的處理要求。
關鍵詞:Booth算法;跳躍式Wallace樹;乘法器;LING加法器
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