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為進一步提高編碼效率，在研究菱形算法的基礎上，采用了“十字”形運動估計算法，設計了硬件電路，并用H‘GA（Field-Pmg隱mmable Gate Amy）實現了算法．結合算法的特點，設計了整體框架結構，提出了一種高度并行、緊湊流水線的FPGA實現方案．用Verilog HDL硬件描述語言設計了編碼，在QuARTuSⅡ集成開發環境下，進行了仿真驗證，并寫入FPGA芯片，實現了“十字”形運動估計算法．經測試表明：該設計方案搜索高效、邏輯簡潔，對比全搜索法占用硬件資源較?。蓮V泛應用到移動視頻通信、遠程無線監控等領域．
運動估計是視頻壓縮中的關鍵環節，被廣泛應用于視頻編碼標準中（如MPEG4）．塊匹配算法是目前應用最廣泛的運動估計算法．其中全搜索算法精度最高，但計算過于復雜，不宜在實時環境中使用．因此，提出了很多快速算法，如T．Koga等提出的三步法¨3和J．R．Jain等提出的二維對數法，由于限制了搜索位的數目，不利于估計小的運動且容易陷入局部最?。又鳵．U等提出的新三步法、L．M．Po等提出的四步法、L．K．uu等提出的梯度下降法等，雖然提高了速度，但邏輯復雜，不利于硬件實現．后來S．zhu等提出的菱形算法‘21，搜索更加高效，但也同樣存在硬件實現時邏輯復雜．筆者通過改變菱形算法，提出一種有利于硬件實現的運動估計算法，并進一步研究采用FPGA實現的方法．
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