Alpha通道是一個8位的灰度通道，該通道用256級灰度來記錄圖像中的透明度信息，定義透明、不透明和....
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FPGA之家 發表于 05-01 10:28
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一個視頻序列是由N個幀組成的，采集圖像的時候一般有2種掃描方式，一種是逐行掃描（progressiv....
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FPGA之家 發表于 04-30 11:50
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Verilog與VHDL語法是互通且相互對應的，如何查看二者對同一硬件結構的描述，可以借助EDA工具....
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FPGA之家 發表于 04-28 17:47
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傳感器是任何工業系統，尤其是工業物聯網解決方案的關鍵組成部分。從簡單的溫度測量熱電偶，到結合多個異構....
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FPGA之家 發表于 04-26 09:56
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2000年的時候，做設計基本都是使用Xilinx公司的Virtex和Virtex-E系列芯片。那時候....
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FPGA之家 發表于 04-26 09:54
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芯片到芯片SERDES最初用于盒間通信。但是，因為它能出色地處理同一塊電路板上的芯片間通信，因而在....
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FPGA之家 發表于 04-11 11:11
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CPU是相通的，相信大部分的同學都學習過單片機，是有一定基礎的。如果你碰到問題，去嘗試了，自己把問題....
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FPGA之家 發表于 03-13 09:38
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IP(Intelligent Property) 核是具有知識產權核的集成電路芯核總稱，是經過反復驗....
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FPGA之家 發表于 03-07 09:35
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SystemVerilog 接口的開發旨在讓設計中層級之間的連接變得更加輕松容易。 您可以把這類接....
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FPGA之家 發表于 03-04 15:25
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集成電路被譽為高端制造業的“皇冠明珠”，而在集成電路里，FPGA又被稱為“萬能芯片”，作為可定制的芯....
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FPGA之家 發表于 01-23 10:46
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CPLD和FPGA都是由邏輯陣列模塊構成的，但是CPLD的LAB基于乘積和宏單元，而FPGA的LAB....
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FPGA之家 發表于 01-23 09:17
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卷積占據了CNN網絡中絕大部分運算，進行乘法運算通常都是使用FPGA中的DSP，這樣算力就受到了器件....
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FPGA之家 發表于 01-19 09:14
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對于FPGA調試，主要以Intel FPGA為例，在win10 Quartus ii 17.0環境下....
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FPGA之家 發表于 01-12 09:34
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大家在進行FPGA選型時都會看見一個參數：Speed Grade，這就是芯片的速度等級。
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FPGA之家 發表于 01-08 09:20
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在數字設計中，時鐘代表從寄存器（register）到寄存器可靠傳輸數據的時間基準。
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FPGA之家 發表于 01-04 09:16
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一般情況下， i2c 設備焊接沒什么問題，按照設備手冊一步步來，基本上就順風順水能夠用起來。如果這么....
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FPGA之家 發表于 12-26 09:33
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首先個人用的是QuartusII11.0，開發板用的是CycloneIV的EP4CE6E22C8N芯....
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FPGA之家 發表于 12-25 09:13
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有一個有趣的現象，眾多數字設計特別是與FPGA設計相關的教科書都特別強調整個設計最好采用唯一的時鐘域....
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FPGA之家 發表于 12-22 09:04
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筆者與SDRAM有段不短的孽緣，它作為冤魂日夜不斷糾纏筆者。筆者嘗試過許多方法將其退散，不過屢試屢敗....
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FPGA之家 發表于 12-15 09:09
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寫了這么多FPGA的文章卻從來沒有涉及過國產FPGA，很多網友甚至不知道還有國產FPGA。下面列舉一....
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FPGA之家 發表于 12-12 11:30
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AD9249的SPI控制模塊包含4根信號線，即CSB1、CSB2、SDIO以及SCLK。但CSB1、....
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FPGA之家 發表于 12-12 10:47
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本篇將以德州儀器(TI)的高速ADC芯片—ads52j90為例，進行ADC的4線SPI配置時序介紹與....
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FPGA之家 發表于 12-11 09:05
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I2C協議中最重要的一點是I2C地址。這個地址有7位和10位兩種形式。
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FPGA之家 發表于 12-05 09:16
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有將近兩個月沒有學習一些新東西，更新一下博客了。一直在忙公司的一個項目，是做一款支持LSTM和RNN....
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FPGA之家 發表于 11-30 09:36
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消失了好久，沒有寫文章，也沒有做筆記，因為最近再趕一個比賽，時間很緊，昨天周六終于結束了，所以趁著周....
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FPGA之家 發表于 11-20 10:04
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帶寬是影響FPGA加速器的重要因素，因為大量的并行計算對數據量要求很大。
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FPGA之家 發表于 11-16 16:36
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單片機晶振電路中兩個微調電容不對稱會怎樣？相差多少會使頻率怎樣變化？我在檢測無線鼠標的接受模塊時，發....
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FPGA之家 發表于 11-15 15:54
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大規模的整數加法在數字信號處理和圖像視頻處理領域應用很多，其對資源消耗很多，如何能依據FPGA物理結....
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FPGA之家 發表于 11-08 09:06
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為了確保寄存器在時鐘沿穩定采集數據，那么必須要滿足寄存器的建立，保持時間要求。 建立時間要求：在寄存....
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FPGA之家 發表于 11-07 09:30
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由于卷積核數據在計算過程中保持不變，更新較慢。這樣就可以利用LUT來存儲權重并同時進行乘法運算。
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FPGA之家 發表于 11-06 09:07
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工商網監