74ls74雙d觸發器引腳圖 74ls74雙D觸發器功能測試
74LS74內含兩個獨立的D上升沿雙d觸發器，每個觸發器有數據輸入（D）、置位輸入（
）復位輸入（
）、時鐘輸入（CP）和數據輸出（Q）。
的低電平使輸出預置或清除，而與其它輸入端的電平無關。當
均無效（高電平式）時，符合建立時間要求的D數據在CP上升沿作用下傳送到輸出端。
74ls74雙d觸發器引腳圖
在ttl電路中，比較典型的d觸發器電路有74ls74。74ls74是一個邊沿觸發器數字電路器件，每個器件中包含兩個相同的、相互獨立的邊沿觸發d觸發器電路模塊。
74ls74雙D觸發器功能測試
74ls74雙D觸發器是一個具有記憶功能的，具有兩個穩定狀態的信息存儲器件，是構成多種時序電路的最基本邏輯單元，也是數字邏輯電路中一種重要的單元電路。
D觸發器的次態取決于觸發前D端的狀態，即次態=D。因此，它具有置0、置1兩種功能。
（文章內容整合自單片機教程網huqin和百度文庫）
編輯：hfy
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